2. 系统建模。对于大型设计，或处理器用作整个设计的一部分时，使用传统的 RTL 模型进行系统仿真可能会非常慢。一种流行的新兴 ESL 方法采用了高速事务级模型，通常使用 C++ 编写，以大大加快系统仿真速度。
ESL 工具为您提供了一种基于虚拟平台的验证环境，您可以在其中分析和调整设计的功能和性能属性。这意味着可以更早使用系统的虚拟表示，实现更大的设计探索和假设分析。
您可以评估和改进性能问题，如延迟、吞吐率和带宽，以及选择性的软件/硬件分割策略。一旦设计满足性能目标，就可将其付诸硅实现。
赛灵思 ESL 倡议
赛灵思认为 ESL 工具具有极大地改变硬件和软件设计者创建、优化和验证复杂电子系统方式的潜力。为了将这一新兴技术的全部优点带给客户，和建立一种适用于特别针对 FPGA 的 ESL 技术的公共平台，赛灵思积极联络其生态系统合作伙伴，成立了协作性的联合 ESL 倡议(表 1)。
该倡议的宗旨是加快针对 FPGA 的 ESL 创新步伐，和使该技术更贴近以软件为中心的用户群的需求。作为倡议的一部分，有以下两个重点：
1. 工程协作。赛灵思将与合作伙伴紧密合作，继续进一步提升 ESL产品阵营的价值，包括改进编译器结果质量和增强工具互操作性及总体易用性等工作。
2. ESL 认识与宣传。赛灵思将向当前及预期新客户宣传面向 FPGA 的 ESL 流程的价值和优点。该计划将试图告知和教育用户有关目前已有 ESL 解决方案类型的知识，以及各种产品如何提供解决现有问题的更好方法。目的是帮助用户就各种合作伙伴 ESL 产品满足其专用需求的适合性做出信息全面的决策。
结语
面向 FPGA 的 ESL 工具为您提供了通过可编程硬件探索您的想法而无需学习与硬件设计有关的低层细节的能力。今天，您有机会从广泛的创新和生产率增强解决方案中选择专门针对赛灵思 FPGA 优化的解决方案。随着 ESL 倡议的正式发布，赛灵思全面投入与第三方生态系统的合作，力图为当前及潜在未来客户提供最佳的 ESL 工具。面向持续更新和新开发随时做好准备。
