基于FPGA和CMX589A的GMSK调制器

2013-10-15 16:21 来源:电子信息网 作者:铃铛


2.2 调制器的系统实现

FM调制器采用DDS思想在FPGA平台上实现。DDS(Direct Digital Frequency Synthesizer,直接数字频率合成)是一种新型的频率合成技术,具有较高的频率分辨率,可以实现快速的频率切换。DDS系统主要由系统时钟源、相 位累加器、正弦波查找表、D/A转换器和低通补偿滤波器组成,系统结构如图3所示。其中相位累加器是DDS系统的核心,它由N位加法器和N位相位寄存器组 成。每来一位参考时钟脉冲,N位加法器将频率控制字和累积器的相位输出相加,把相加的结果送到相位寄存器的输入端。相位寄存器一方面将输出的相位数据反馈 到加法器的输入端,以使加法器继续在时钟脉冲的作用下继续与频率控制字相加,另一方面又将输出的相位数据又作为波形存储表的地址输入。波形存储表把输入的 地址相位信息映射成波形数据,最后经过DAC和低通滤波器得到模拟信号。

006


本设计采用20 MHz外部晶振作为时钟源,系统采用40位相位累加器,故频率字也取40位,所以系统的频率分辨率如下式所示:

007


FM调制器完成幅度到频率的转换是系统设计的关键。例如设定基带信号的速率为8 kHz,载波的中心频率为200 kHz(fword=“10995116277”),为了实现调制指数为0.5的FM调制器,FM调制器的频率差为4 kHz。FPGA根据8位A/D转换器输入的信号幅度值选择相应的频率字,从而控制输出信号的频率完成调频功能。载波的中心频率对应的A/D转换器中心幅 值a in=“10000 0000”;当A/D转换器输入为O V(即a in=“0000 0000”)时,对应的调制信号的输出频率为198 kHz(fword=“10885165114”);当A/D转换器的输入为满刻度2 V(ain=“1111 1111”)时,调制输出频率为202 kHz(fword=“11105067440”)。把频率从198 kHz到202 kHz等分成255份,把相应的频率转换成40位频率字,则A/D转换器的256个幅值与256个频率字一一对应。在每一个系统时钟周期,频率控制字与 40位的相位累加器的值相加结果存入相位累加器。由于选用的ROM查找表的地址线为10位,所以取相位累加器的高10位作为正弦查找表的地址。正弦查找表 利用Cyclone内部的ROM模块完成查找表的设计,字长为10位,与所选用的DAC的数据位数相匹配。 系统输入信号的幅度与频率字转换的核心代码如下:

008


其中,f_mid为调制信号的中心频率,fm_frerom为A/D输入的信号幅度值与频偏之间的映射关系,系统根据接收到信号的幅度值相应改变调制信号的频偏从而完成调制功能。

3 系统软件仿真及测试

3.1 软件仿真

本设计利用EDA工具QuartusⅡ6.O完成调制器软件编程,通过编译环境进行软件仿真如图4所示,其中clk为系统晶振时钟,addr40为相位累 加器,a_in为A/D的转换器的8位输出信号,fword为系统频率字,fout为波表输出的调制信号幅度值。

009


3.2 系统测试与分析

系统测试通过IFR2399A频谱仪来完成系统的硬件测试。图5表示在相同的硬件平台上实现MSK调制的频谱图,图6表示GMSK调制的频谱图。对比两个 图可以发现,由于加入了高斯滤波器,GMSK的频谱更加紧凑,带外衰减也要快于MSK。同时由测试结果可以看出,中频载波为200 kHz,主瓣宽度以及衰减状况等与理论分析结果相符。

010


4 结 语

本文实现了一种基于CMX589A和FPGA的GMSK调制器。系统采用了主从式的结构,主控机由单片机实现对于GMSK调制器系统参数的控 制,CMX589A模块完成基带信号高斯滤波,FM调制器采用直接数字频率合成技术(DDS)在FPGA硬件平台上实现、系统最高输出频率为25 MHz。同时系统具有很宽的基带信号数据和调制参数灵活可控等特点,并且克服了正交调制方案中严格正交载波产生困难的缺陷。测试结果表明,已调信号包络恒 定,频谱满足设计要求,适用于CDPD,无中心站等多种通信系统。

< 1 2 
GMSK CMX589A

相关阅读

暂无数据

一周热门